Cadence IC618使用

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Cadence IC618使用

2023-09-30 06:34| 来源: 网络整理| 查看: 265

提示：此博文仅记录博主在学习cadence ic618中遇到的问题，详细的教学请参考其他资料

目录前言一、Cadence相关使用教程1.1 工艺库的设置1.2 瞬态仿真下的变量参数修改二、Analoglib中的理想MOS管不能进行电路仿真三、使用理想元器件搭建简单的RC无源滤波器原理与电路图ADE_L仿真设置与结果可能遇到的问题仿真结果为直线其他错误常见的报错信息1. 无法选中编辑元器件1. 打开电路图显示颜色不正常，均为黄色

前言

以下仅为个人学习记录。如有错误，欢迎指正，交流学习。

一、Cadence相关使用教程 1.1 工艺库的设置

Cadence下可能存在多个cds.lib文件，但工艺库的定义一般只在软件指定的其中一个文件。此cds.lib的路劲设置可以在新建Cellview的时候看到。

在这里插入图片描述 cds.lib工艺库的定义文件，可以参考修改定义自己的工艺库

1.2 瞬态仿真下的变量参数修改

time代表时间节点，在某个设置的time节点以后，变量的值将刷新为新赋值的value 在这里插入图片描述

在这里插入图片描述

二、Analoglib中的理想MOS管不能进行电路仿真

Analoglib中的理想MOS管不能进行电路仿真，否则会出现工艺库未定义的报错。比如我想对一个反相器进行仿真，使用了Analoglib中的nmos4与pmos4。使用specture进行仿真时，会有如下报错：反相器的电路图

ERROR (SFE-23): "input.scs" 13: The instance `M0' is referencing an undefined model or subcircuit, `pmos4'. Either include the file containing the definition of `pmos4', or define `pmos4' before running the simulation. ERROR (SFE-23): "input.scs" 14: The instance `M1' is referencing an undefined model or subcircuit, `nmos4'. Either include the file containing the definition of `nmos4', or define `nmos4' before running the simulation.

Tips: 必须指定工艺库，如果想搭一个理想的inverter可以导入其他理想工艺库。仿真时工艺库的定义： ADE_L—>Setup—>Model Libraries 在这里插入图片描述一般后缀为.scs文件

三、使用理想元器件搭建简单的RC无源滤波器原理与电路图

虽然analoglib中的MOS管不能直接用来进行电路仿真，但是电容电阻等理想器件等是可以直接使用并仿真的。仿真使用的cellview如下图所示。在这里插入图片描述截止频率 f (-3dB 频率)与R, C的约束关系为： f = 1 2 π R C f = \frac{1}{{2\pi RC}} f=2πRC1

ADE_L仿真设置与结果

计算器的设置首先点击vf 然后在电路图中选择对应的端口（分别是电阻的输入端和输出端），最后使用dB20函数计算比值

vf 为交流电压创建一个表达式if 为交流电流创建一个表达式vt 为瞬态电压创建一个表达式it 为瞬态电流创建一个表达式vdc 为直流电压创建一个表达式idc 为直流电流创建一个表达式vs DC sweep voltageis DC sweep currentos 直流工作点如果有不清楚的可以把鼠标停留在表达式上方，会有相应的的解释或者查看帮助文档在这里插入图片描述

进行交流仿真，仿真时建议使用对数扫描的方式，这样在低频处能扫描得到更多的点。如果使用线性扫描的方式，曲线会降落的很快。 points per decade表示每10倍频中会扫描1000个点。比如0.1Hz-1Hz 会有1001个点number of steps表示仿真的总点数

在这里插入图片描述仿真曲线：

使用marker功能，找到y值为-3dB的一个点在这里插入图片描述

可以看到截止频率精确值为 3.17555 KHz，大家可以自行代入公式计算理论值，验证结果在这里插入图片描述

可能遇到的问题仿真结果为直线

在进行交流仿真是，必须给vdc指定一个交流电压值，直流电压有没有都无所谓。否则将得到错误的结果，如图所示。在本实验中，电压源设置直流电压为0V，交流电压为1V。在这里插入图片描述

其他错误

每次修改电路图以后需要先x(check and save)一下，再运行仿真，否则会报如下错误

ERROR (OSSHNL-109): The cellview 'My_Work/RC_passive_filter/schematic' has been modified since the last extraction. Validate that the schematic is correct and run Check and Save to correct this error. ERROR (OSSHNL-514): Netlist generation failed because of the errors reported above. The netlist might not have been generated at all, or the generated netlist could be corrupt. Fix the reported errors and regenerate the netlist unsuccessful. 常见的报错信息 1. 无法选中编辑元器件

当选中元器件进行编辑参数的时候，自动跳到virtuoso log界面并且出现如下报错信息

*Warning* You are selecting from a cellview which is not part of the design hierarchy or the same session, selection not take.

这通常是由于其中一个原理图处于信号变量选择状态（通常发生在进行仿真时的波形查看），而此时你又在另外一个电路原理图中进行编辑。这时候只需要回到之前的原理图，按esc取消信号变量选择即可。

1. 打开电路图显示颜色不正常，均为黄色

今天打开其他人提供的电路图文件时显示为黄色。如下图所示：在这里插入图片描述

查看报错信息warning：

在这里插入图片描述解决方法：merge其他人提供给你的display文件和自用的工艺库display文件点击Display Resource Manager 点击merge merge 其他电路图的display文件和自己用的工艺库dispaly文件即可

待续，不定时更新

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